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异步时序电路中的亚稳态设计与分析
中文名称: 异步时序电路中的亚稳态设计与分析
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论文编号: 3152750收藏本论文】【我的收藏】【我要投稿
英文名称: The Analyse and Design about Meta-Stability in Asynchronous Timing Circuits
学位类型: 硕士毕业论文
作者: 涉及隐私,隐去***  作者本人请参看权力声明>>
导师: 涉及隐私,隐去***
毕业学校: 涉及隐私,隐去***
专业: 软件工程
毕业年份: 涉及隐私,隐去***
关键字: 异步时钟 亚稳态 异步串行接口 FIFO
简介目录: 点击此处 免费索取本论文简介和目录>>
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       论文发表:快速、低价、包过!发表论文就找论文天下

论文摘要: 在现代IC、ASIC以及FPGA设计中,许多软件程序可以帮助工程师建立几百万门的电路,但这些程序都无法解决(略).设计者需要了解可靠的设计技巧,以减少电路在跨时钟域通信时的故障风险.设计数字电路时同步是非常重要的,特别当要输入一个信号到一个同步电路中,但是该信号由另一个时钟(略)要在接口处采取一些措施,使输入的异步信号同步化,否则电路将无法正常工作,因为输入端很可能出现亚稳态(Meta-stability),导致采样错误.本文对亚稳态的起因、危害、对可靠性的影响和消除仿真做一些介绍与分析,提供了解决亚稳态问题的解决方案,并以UART为例验证其可行性.
In many designs of IC, ASIC, FPGA, more software can help engineers to build(omitted)illion gates circuit, but all the programs can’t solve the problem of signals’synchronizatio(omitted)igners need know more reliable design skills in order to decrease the risk of multiple clock dom(omitted) very important to synchronize the signals when design digital circuits, e(omitted)input a signal through a different cl(omitted). The asynchronous input signal must be synchronized, otherwise the circuit will not be...
目录:
摘要第2-3页
Abstract第3页
第1章 绪论第6-7页
  ·引言第6页
  ·概述第6-7页
第2章 异步电路设计概述第7-15页
  ·异步设计概述第7-9页
  ·亚稳态定义第9-11页
  ·亚稳态分析第11-12页
  ·同步器设计第12-13页
  ·高级数据路径设计FIFO第13-14页
  ·实例应用第14-15页
第3章 UART协议第15-36页
  ·UART 协议的工作特点第15-19页
    ·数据采样第15-16页
    ·UART 帧区分第16页
    ·UART 地址识别第16页
    ·串口通信基本接线方法第16-19页
  ·功能简介第19-20页
  ·UART 波特率发生器(BRG)第20-23页
    ·波特率表第22-23页
  ·UART 配置第23页
    ·使能UART第23页
    ·禁止UART第23页
    ·备用UART I/O 引脚第23页
  ·UART 发送器第23-26页
    ·发送缓冲器(UxTXB)第24-25页
    ·发送中断第25页
    ·设置UART 发送第25-26页
    ·中止字符的发送第26页
  ·UART 接收器第26-30页
    ·接收缓冲器(UxRXB)第27页
    ·接收器错误处理第27-28页
    ·FIFO 中断方式操作第28-29页
    ·设置UART 接收第29-30页
  ·UART 的其他特性第30页
    ·环回模式下的UART第30页
    ·自动波特率支持第30页
  ·与UART 模块相关的寄存器第30-36页
第4章 实验方案第36-44页
  ·前端流程第36-43页
    ·功能框图第36-41页
    ·代码及仿真波形第41-43页
  ·后端流程第43-44页
第5章 实验结果及结论第44-46页
  ·测试结果结论第44-45页
  ·测试条件第45-46页
参考文献第46-50页
附录第50-53页
致谢第53-54页
攻读学位期间发表的学术论文第54页
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